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一站式定制芯片及IP供应商灿芯半导体推出PCIe

时间:2025-08-14 10:24

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作者:admin

标签: PHY  IP  PCIe 4.0 

导读:2025年8月14日,一站式定制芯片及IP供应商——灿芯半导体(上海)股份有限公司(灿芯股份,688691)宣布推出基于28HKC+ 0.9V/1.8V平台的 PCIe 4.0 PHY IP 。该PHY IP符合PCIe 4.0规范的要求,支持...

2025年8月14日,一站式定制芯片及IP供应商——灿芯半导体(上海)股份有限公司(灿芯股份,688691)宣布推出基于28HKC+ 0.9V/1.8V平台的PCIe 4.0 PHY IP。该PHY IP符合PCIe 4.0规范的要求,支持PIPE 4.4.1/5.2接口2.5Gbps至16Gbps的数据传输速率,全面覆盖PCIe Gen4.0/3.0/2.0/1.0标准,并兼容Rapid IO、JESD204B/C、USB3.2/3.1/3.0、10GBASE-R/KR等其他协议。凭借其优越的性能和低功耗特性,该PCIe 4.0 IP可广泛应用于基于RISC-V内核的芯片定制、人工智能机器学习、高性能计算、边缘计算、5G通信基站、通信与网络设备、智能图像处理、AR/VR,以及汽车电子中的辅助驾驶和智能座舱等应用场景,满足高速数据传输、低功耗设计中的高性能需求。

灿芯半导体此次发布的PCIe 4.0 IP在不同应用中具有灵活配置的能力,可以通过并行或级联的双重锁相环来实现;同时,通用高速LC-PLL时钟生成模块可根据抖动需求为8+通道提供时钟支持,从而实现1x、2x、4x、8x等灵活的宏配置。另外,在数据通道中使用独立锁相环,可提高能效,并允许其在不同协议中进行单独配置。该PCIe 4.0 IP在数据传输和接收过程中进行时钟和模拟前端(AFE)偏移校准,不会中断,有处理大频率偏移的能力;可配置不同的数据宽度,如8位、16位、20位、32位、40位等,且支持高覆盖率全速内置自检(BIST)及环回测试。这些特性表明该IP适用于多种应用场景,提供高效、灵活和精确的时钟及数据校准,确保数据传输的可靠性和稳定性

目前,该IP已成功流片,并顺利通过芯片级的功能测试和性能测试,各项指标均达到预期标准,已实现客户的量产交付。

关于灿芯半导体

灿芯半导体(上海)股份有限公司(灿芯股份,688691)是一家提供一站式定制芯片及IP的高新技术企业,为客户提供从芯片规格制定、架构设计到芯片成品的一站式服务,致力于为客户提供高价值、差异化的解决方案。

灿芯半导体的“YOU”系列IP和YouSiP(Silicon-Platform)解决方案,经过了完整的流片测试验证。其中YouSiP方案可以为系统公司、无厂半导体公司提供原型设计参考,从而快速赢得市场。

灿芯半导体成立于2008年,总部位于中国上海,为客户提供全方位的优质服务。

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