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Vivado开发技巧：综合策略与合适的编译顺序

综合（Synthesis）是指将RTL设计转换为门级描述。Vivado开发套件中的综合工具是一款时序驱动型、专为内存使用率和性能优化的综合工具，支持System Verilog ...

阅读全文2020-12-29

FPGA设计案例：数据缓存模块设计与验证实验

本文设计思想采用明德扬至简设计法。上一篇博文中定制了自定义MAC IP的结构，在用户侧需要位宽转换及数据缓存。本文以TX方向为例，设计并验证发送缓...

阅读全文2020-12-28

Xilinx ZYNQ开发案例HelloWorld实验工程

前言：使用的板子是zc702。用Vivado的IP核搭建最小系统，包括ARM核（CPU xc7z020），DDR3（4×256M），一个UART串口（Mini USB转串口），纯PS，通过串口打印出Hell...

阅读全文2020-12-26

xilinx zynq RapidIO系统的初始化启动过程概述

系统初始化之后，所有器件都会拥有一个ID，在系统初始化之前，按照下面设置。RapidIO系统应该只有一个引导代码器件。...

阅读全文2020-12-26

ZYNQ EMIO重用封装实现算法板级验证

为了快速实现算法板级验证，PC端需要通过JTAG或以太网与FPGA形成通路。最简单便捷的方案是利用协议栈芯片，用户可以无视底层，利用简单的SPI协议读写寄...

阅读全文2020-12-25

使用vivado的过程如何清理/压缩不必要的文件

作者：材哥，玩儿转FPGA 前言 vivado和ISE的使用差别很大，Vivado是专门针对7系列和以后系列的FPGA/AP SOC进行高效设计的工具，特别是最近提出的UltraFast设计方...

阅读全文2020-12-25

PYNQ案例（二）：ZYNQ与PYNQ的区别与联系

Zynq可扩展处理平台是赛灵思新一代 FPGA的可编程技术的产品系列。与采用嵌入式处理器的FPGA不同，Zynq产品系列的处理系统不仅能在开机时启动，而且还可...

阅读全文2020-12-25

PYNQ案例（一）：ZYNQ的PL与PS开发

上一期的学习中，我们系统性地介绍了PYNQ与ZYNQ地区别与联系。PYNQ = Python + ZYNQ，即将ZYNQ部分功能的Python化，直接调用Python库和FPGA硬件库进行功能的开发。...

阅读全文2020-12-25

基本数学运算在FPGA中的实现算法仿真分析

仿真波形表明，计算结果与MATLAB浮点运算相近，满足一般计算需求。若想提高精度，可以增加CORDIC输出数据位宽。...

阅读全文2020-12-25

基于Xilinx FPGA的复位信号处理

作者：NingHeChuan Get Smart About Reset: Think Local, Not Global。对于复位信号的处理，为了方便我们习惯上采用全局复位，博主在很长一段时间内都是将复位信号作...

阅读全文2020-12-25

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