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如何做一条合格的path？同一条path在物理设计不同

Delay值是多少才算合格呢？这一篇开始讲解路径(Path)的概念，以及衡量Path Delay是否合格的标准----建立时间(setup time)和保持时间(hold time)。...

阅读全文2023-06-27

6月28日直播预估|CI/CT持续集成测试解决方案

CI/CT(Continuous Integration/Continuous Test，持续集成/持续测试)是一种软件开发实践。核心是通过一系列测试工具链的组合与自动化测试工程结合，提交新版软件时...

阅读全文2023-06-27

STA-0.静态时序分析概述

静态时序分析（Static Timing Analysis, 以下统一简称 **STA** ）是验证数字集成电路时序是否合格的一种方法，其中需要进行大量的数字计算，需要依靠工具进行...

阅读全文2023-06-27

图像流AXI-Stream生成BMP文件的实现思路

在实现上，由于bmp除去文件头后也只是把图像流数据按顺序放而已...

阅读全文2023-06-27

教你如何书写高质量的Verilog代码？

HDL 语言仅是对已知硬件电路的文本表现形式编写前，对所需实现的硬件电路“胸有成竹”...

阅读全文2023-06-27

铝电解电容是怎样制造出来的？它有哪些特性？

铝电解电容是唯一有“水”的元器件，不爽的时候还会爆浆，因为具有很高的单位CV值和价格低廉而被广泛使用在各种电子产品中。...

阅读全文2023-06-27

Xilinx高质量时钟输出ODDR原语的概述及使用方法

在SDR接口中，ODDR转发时钟（仍在时钟树内），输出端要直连到输出port，不可加逻辑...

阅读全文2023-06-27

扭环形计数器与环形计数器的随机序列

扭环形计数器，每次状态变化时仅有一个触发器发生翻转，译码不存在竞争冒险，在n（n≥3）位计数器中，使用2n个状态，有2^n-2n个状态未使用；...

阅读全文2023-06-27

合宙新品开发板排队来~Air001、Air601、树莓派，哪

用代码写诗，用PCB作画看松香袅袅，听同频心跳……如果你也一样热爱那么在时间的光影里共同书写属于我们的故事合宙超值开发板Air001、Air601、RP2040新品...

阅读全文2023-06-27

vcpkg-最简单的各版本pcl编译方法介绍

VCPKG是微软C++ 团队开发的适用于C 和C++ 库的跨平台开源软件包管理器，它大大简化了Windows、Linux 和macOS 上第三方库相关的下载和配置操作。...

阅读全文2023-06-27

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